株式会社セルシステム

【回路設計】独自技術/計測器メーカー/管理職/回路設計/FPGA設計/アナログ回路設計

  • 外国籍の方も活躍中
  • BtoB向け
年収
600~800万円
最寄り駅
江田駅 (神奈川県)
職種
組込・制御エンジニア

仕事内容について

■業務内容:
開発を担う"技術部"にて、製品の設計・開発作業を行うことが主業務となります。開発前にはチームで客先要望に基づき要件定義をし、開発スタート

回路設計部署は3つのグループに分かれており、電気グループのプレイングマネージャーでの配属です。
電気グループ★
機構グループ
ソフトウェアグループ

■業務概要:
・自社製電気基板の回路設計
・FPGA設計※主にインテル(旧アルテラ)製
・アナログ回路設計
・デジタル回路設計
・マネジメント業務

【仕事の特色】
当社は、光と熱をコントロールするプロ集団として、お客様に喜んでいただける革新的な製品を開発しており、
半導体レーザーやペルチェの制御、LED光源のメーカーとして多くの産業発展に寄与しています。

中でも、ペルチェ素子と独自の制御回路を用いた温度制御技術は尖ったものがあり、
安定度±0.001℃の温度制御を実現し、世界の3大メーカーとなっております。
主要取引先は、世界で活躍する製造業界の名だたる有名企業様が名を連ねており、その為、業績も安定し、
高い技術力と丁寧なフォローアップ体制に大きな信頼をいただき、盤石な経営基盤を築いております。

自動車、航空宇宙、バイオメディカル、半導体製造装置、鉄道、各種エネルギー、貴金属、ロボティクス、
精密機器、通信事業、素材・化学といった製造業界、あるいは国立研究開発所や大学等、私たちの技術は世界のものづくり業界の発展に貢献しております。

■服装補足
・私服(客先ではスーツなど)
・面接時はビジネスカジュアル

【仕事内容(変更の範囲)】
無し

必須条件

・普通自動車運転免許(AT限定可)
・マネジメント経験3年以上(業界職種問わず)
・デジタル回路設計者
└Verilog HDLもしくはVHDLの使用経験が5年以上ある方
・アナログ回路設計者
└オペアンプを使用した低周波増幅回路などのアナログ回路設計技術が5年以上ある方

歓迎要件

・回路設計業務でのマネジメント経験者

想定年収

600~800万円 (給与形態:月給)

■賞与・昇給
賞与:業績連動型賞与 (7月・12月の賞与)
昇給:年1回 (4月)

■募集職種の年収例

<予定年収>
600万円~800万円

<賃金内訳>
月額(基本給):300,000円~400,000円
その他固定手当/月:8,000円~23,000円

※年収は諸手当(住宅手当、食事手当)、賞与を含んだ金額となります。

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募集要項

募集職・職位
  • 組込・制御エンジニア
業界
  • IT・通信
  • ソフトウェア
  • メーカー
  • 電気・電子・機械・半導体
雇用形態

正社員

予定勤務地
本社(神奈川県横浜市青葉区あざみ野南1-2-8)
予定勤務地
(変更の範囲)
無し
就業時間
09:00~18:00 
就業時間備考
・所定労働時間:8時間0分
・残業:月平均30時間
平均残業時間
30時間以上
年間休日
118日
服装
私服
福利厚生

■制度
<福利厚生制度>
・退職金制度:勤続3年以上/65歳までの再雇用あり
・退職金共済

試用期間
3ヶ月
休日休暇

■休日制度
完全週休二日制、年末年始休暇、夏季休暇、年次休暇、育児休暇

■休暇備考
土曜、日曜は休み ※祝日は出勤日となる

手当

通勤手当、家族手当、住宅手当、食事手当(3000円)

・通勤手当:実費(上限なし)
・住宅手当:5千円~2万円(固定)

選考場所

本社

検査・試験

実施される可能性がございます

提出書類

履歴書、職務経歴書

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株式会社セルシステムが募集している求人・転職・採用情報

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株式会社セルシステムについて

設立年月日
1990年02月20日
代表者
代表取締役 渡 脩
資本金
3,468万円
従業員情報
25名
事業内容
計測及び解析装置の開発、製作
特殊計測器の開発、製作
治具の開発、製作
各種プリント基板設計、製作
ソフトウェアの開発

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出典:レバテックキャリアが保有する対象求人を下限年収で算出(2024年9月地点)

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